舉例來(lái)說，在芯片設(shè)計(jì)過程中，設(shè)計(jì)驗(yàn)證工程師常常要加班加點(diǎn)運(yùn)行無(wú)數(shù)次回歸，為實(shí)現(xiàn)覆蓋率目標(biāo)耗費(fèi)心神，即使在驗(yàn)證方面投入非常大的人力和時(shí)間，流片時(shí)出現(xiàn)功能失效的風(fēng)險(xiǎn)也很高。針對(duì)這一問題，Xcelium 的機(jī)器學(xué)習(xí) App（Xcelium Machine Learning）引入了 Cadence 專有的機(jī)器學(xué)習(xí)技術(shù)，它不僅能加速覆蓋收斂，還可從以往的回歸運(yùn)行中學(xué)習(xí)并指導(dǎo) Xcelium 隨機(jī)引擎，在實(shí)現(xiàn)相同覆蓋率的前提下大幅度減少仿真次數(shù)，最多可以減少十倍，或者是在特定的覆蓋點(diǎn)產(chǎn)生激勵(lì)以便發(fā)現(xiàn)更多的漏洞。通過減少仿真次數(shù)和更精準(zhǔn)的測(cè)試激勵(lì)，工程師們可以更加專注于發(fā)現(xiàn)和解決設(shè)計(jì)中的問題，而不是被重復(fù)的回歸運(yùn)行所困擾。

再比如，針對(duì)汽車中的功能安全，Cadence 的 Xcelium 是市面上唯一一款在主引擎中啟用并發(fā)注入的仿真器，Xcelium Safety App 能夠同時(shí)支持串行和并行故障仿真。結(jié)合 Jasper Safety、vManager Safety 和 Midas Safety Planner 等 Cadence 安全驗(yàn)證全流程工具，Xcelium 能夠高效地執(zhí)行安全錯(cuò)誤注入，以滿足 ISO26262 標(biāo)準(zhǔn)的要求。此外，Cadence 提供了廣泛的汽車功能安全文檔套件，涵蓋了半導(dǎo)體設(shè)計(jì)和驗(yàn)證的全譜系。該套件大大減少了供應(yīng)商在每個(gè)汽車設(shè)計(jì)項(xiàng)目中進(jìn)行工具用例評(píng)估的工作量，并幫助他們避免昂貴的工具認(rèn)證工作。

而對(duì)于想要走 Chiplet 路線的芯片公司，Xcelium 的多核應(yīng)用（Multi-Core App）是一個(gè)高度可擴(kuò)展的用于加速門級(jí)仿真的解決方案。它自動(dòng)將芯片設(shè)計(jì)分解成若干個(gè)獨(dú)立的部分，并在服務(wù)器的并行內(nèi)核上對(duì)其進(jìn)行仿真，從而大大縮短了 SystemVerilog 設(shè)計(jì)的仿真用時(shí)，尤其適用于大規(guī)模設(shè)計(jì)。

結(jié)語(yǔ)

總的來(lái)說，我們正處在芯片行業(yè)的一個(gè)變革時(shí)期，創(chuàng)新和速度是成功的關(guān)鍵。新技術(shù)的快速發(fā)展和新需求的持續(xù)涌現(xiàn)，使得芯片設(shè)計(jì)的復(fù)雜度呈現(xiàn)指數(shù)級(jí)增長(zhǎng)。而在這個(gè)過程中，如何提高生產(chǎn)效率，如何縮短產(chǎn)品上市時(shí)間，這都是設(shè)計(jì)工程師面臨的挑戰(zhàn)。仿真器的介入，將是芯片廠商們探索新技術(shù)、解決復(fù)雜芯片設(shè)計(jì)難題的得力工具。

相信在 Xcelium Logic Simulator 及多種 Apps 組合，大小型芯片公司都能夠更自信地迎接新一代芯片設(shè)計(jì)過程中的復(fù)雜性挑戰(zhàn)，快速推進(jìn)設(shè)計(jì)驗(yàn)證，將創(chuàng)新產(chǎn)品迅速推向市場(chǎng)，朝著更高、更遠(yuǎn)的未來(lái)邁進(jìn)。

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